root / target-ppc / kvm.c @ 1dd9ffb9
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1 | d76d1650 | aurel32 | /*
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2 | d76d1650 | aurel32 | * PowerPC implementation of KVM hooks
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3 | d76d1650 | aurel32 | *
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4 | d76d1650 | aurel32 | * Copyright IBM Corp. 2007
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5 | d76d1650 | aurel32 | *
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6 | d76d1650 | aurel32 | * Authors:
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7 | d76d1650 | aurel32 | * Jerone Young <jyoung5@us.ibm.com>
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8 | d76d1650 | aurel32 | * Christian Ehrhardt <ehrhardt@linux.vnet.ibm.com>
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9 | d76d1650 | aurel32 | * Hollis Blanchard <hollisb@us.ibm.com>
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10 | d76d1650 | aurel32 | *
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11 | d76d1650 | aurel32 | * This work is licensed under the terms of the GNU GPL, version 2 or later.
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12 | d76d1650 | aurel32 | * See the COPYING file in the top-level directory.
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13 | d76d1650 | aurel32 | *
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14 | d76d1650 | aurel32 | */
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15 | d76d1650 | aurel32 | |
16 | d76d1650 | aurel32 | #include <sys/types.h> |
17 | d76d1650 | aurel32 | #include <sys/ioctl.h> |
18 | d76d1650 | aurel32 | #include <sys/mman.h> |
19 | d76d1650 | aurel32 | |
20 | d76d1650 | aurel32 | #include <linux/kvm.h> |
21 | d76d1650 | aurel32 | |
22 | d76d1650 | aurel32 | #include "qemu-common.h" |
23 | d76d1650 | aurel32 | #include "qemu-timer.h" |
24 | d76d1650 | aurel32 | #include "sysemu.h" |
25 | d76d1650 | aurel32 | #include "kvm.h" |
26 | d76d1650 | aurel32 | #include "kvm_ppc.h" |
27 | d76d1650 | aurel32 | #include "cpu.h" |
28 | d76d1650 | aurel32 | #include "device_tree.h" |
29 | d76d1650 | aurel32 | |
30 | d76d1650 | aurel32 | //#define DEBUG_KVM
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31 | d76d1650 | aurel32 | |
32 | d76d1650 | aurel32 | #ifdef DEBUG_KVM
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33 | d76d1650 | aurel32 | #define dprintf(fmt, ...) \
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34 | d76d1650 | aurel32 | do { fprintf(stderr, fmt, ## __VA_ARGS__); } while (0) |
35 | d76d1650 | aurel32 | #else
|
36 | d76d1650 | aurel32 | #define dprintf(fmt, ...) \
|
37 | d76d1650 | aurel32 | do { } while (0) |
38 | d76d1650 | aurel32 | #endif
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39 | d76d1650 | aurel32 | |
40 | d76d1650 | aurel32 | int kvm_arch_init(KVMState *s, int smp_cpus) |
41 | d76d1650 | aurel32 | { |
42 | d76d1650 | aurel32 | return 0; |
43 | d76d1650 | aurel32 | } |
44 | d76d1650 | aurel32 | |
45 | d76d1650 | aurel32 | int kvm_arch_init_vcpu(CPUState *cenv)
|
46 | d76d1650 | aurel32 | { |
47 | d76d1650 | aurel32 | return 0; |
48 | d76d1650 | aurel32 | } |
49 | d76d1650 | aurel32 | |
50 | d76d1650 | aurel32 | int kvm_arch_put_registers(CPUState *env)
|
51 | d76d1650 | aurel32 | { |
52 | d76d1650 | aurel32 | struct kvm_regs regs;
|
53 | d76d1650 | aurel32 | int ret;
|
54 | d76d1650 | aurel32 | int i;
|
55 | d76d1650 | aurel32 | |
56 | d76d1650 | aurel32 | ret = kvm_vcpu_ioctl(env, KVM_GET_REGS, ®s); |
57 | d76d1650 | aurel32 | if (ret < 0) |
58 | d76d1650 | aurel32 | return ret;
|
59 | d76d1650 | aurel32 | |
60 | d76d1650 | aurel32 | regs.ctr = env->ctr; |
61 | d76d1650 | aurel32 | regs.lr = env->lr; |
62 | d76d1650 | aurel32 | regs.xer = env->xer; |
63 | d76d1650 | aurel32 | regs.msr = env->msr; |
64 | d76d1650 | aurel32 | regs.pc = env->nip; |
65 | d76d1650 | aurel32 | |
66 | d76d1650 | aurel32 | regs.srr0 = env->spr[SPR_SRR0]; |
67 | d76d1650 | aurel32 | regs.srr1 = env->spr[SPR_SRR1]; |
68 | d76d1650 | aurel32 | |
69 | d76d1650 | aurel32 | regs.sprg0 = env->spr[SPR_SPRG0]; |
70 | d76d1650 | aurel32 | regs.sprg1 = env->spr[SPR_SPRG1]; |
71 | d76d1650 | aurel32 | regs.sprg2 = env->spr[SPR_SPRG2]; |
72 | d76d1650 | aurel32 | regs.sprg3 = env->spr[SPR_SPRG3]; |
73 | d76d1650 | aurel32 | regs.sprg4 = env->spr[SPR_SPRG4]; |
74 | d76d1650 | aurel32 | regs.sprg5 = env->spr[SPR_SPRG5]; |
75 | d76d1650 | aurel32 | regs.sprg6 = env->spr[SPR_SPRG6]; |
76 | d76d1650 | aurel32 | regs.sprg7 = env->spr[SPR_SPRG7]; |
77 | d76d1650 | aurel32 | |
78 | d76d1650 | aurel32 | for (i = 0;i < 32; i++) |
79 | d76d1650 | aurel32 | regs.gpr[i] = env->gpr[i]; |
80 | d76d1650 | aurel32 | |
81 | d76d1650 | aurel32 | ret = kvm_vcpu_ioctl(env, KVM_SET_REGS, ®s); |
82 | d76d1650 | aurel32 | if (ret < 0) |
83 | d76d1650 | aurel32 | return ret;
|
84 | d76d1650 | aurel32 | |
85 | d76d1650 | aurel32 | return ret;
|
86 | d76d1650 | aurel32 | } |
87 | d76d1650 | aurel32 | |
88 | d76d1650 | aurel32 | int kvm_arch_get_registers(CPUState *env)
|
89 | d76d1650 | aurel32 | { |
90 | d76d1650 | aurel32 | struct kvm_regs regs;
|
91 | d76d1650 | aurel32 | uint32_t i, ret; |
92 | d76d1650 | aurel32 | |
93 | d76d1650 | aurel32 | ret = kvm_vcpu_ioctl(env, KVM_GET_REGS, ®s); |
94 | d76d1650 | aurel32 | if (ret < 0) |
95 | d76d1650 | aurel32 | return ret;
|
96 | d76d1650 | aurel32 | |
97 | d76d1650 | aurel32 | env->ctr = regs.ctr; |
98 | d76d1650 | aurel32 | env->lr = regs.lr; |
99 | d76d1650 | aurel32 | env->xer = regs.xer; |
100 | d76d1650 | aurel32 | env->msr = regs.msr; |
101 | d76d1650 | aurel32 | env->nip = regs.pc; |
102 | d76d1650 | aurel32 | |
103 | d76d1650 | aurel32 | env->spr[SPR_SRR0] = regs.srr0; |
104 | d76d1650 | aurel32 | env->spr[SPR_SRR1] = regs.srr1; |
105 | d76d1650 | aurel32 | |
106 | d76d1650 | aurel32 | env->spr[SPR_SPRG0] = regs.sprg0; |
107 | d76d1650 | aurel32 | env->spr[SPR_SPRG1] = regs.sprg1; |
108 | d76d1650 | aurel32 | env->spr[SPR_SPRG2] = regs.sprg2; |
109 | d76d1650 | aurel32 | env->spr[SPR_SPRG3] = regs.sprg3; |
110 | d76d1650 | aurel32 | env->spr[SPR_SPRG4] = regs.sprg4; |
111 | d76d1650 | aurel32 | env->spr[SPR_SPRG5] = regs.sprg5; |
112 | d76d1650 | aurel32 | env->spr[SPR_SPRG6] = regs.sprg6; |
113 | d76d1650 | aurel32 | env->spr[SPR_SPRG7] = regs.sprg7; |
114 | d76d1650 | aurel32 | |
115 | d76d1650 | aurel32 | for (i = 0;i < 32; i++) |
116 | d76d1650 | aurel32 | env->gpr[i] = regs.gpr[i]; |
117 | d76d1650 | aurel32 | |
118 | d76d1650 | aurel32 | return 0; |
119 | d76d1650 | aurel32 | } |
120 | d76d1650 | aurel32 | |
121 | d76d1650 | aurel32 | int kvm_arch_pre_run(CPUState *env, struct kvm_run *run) |
122 | d76d1650 | aurel32 | { |
123 | d76d1650 | aurel32 | int r;
|
124 | d76d1650 | aurel32 | unsigned irq;
|
125 | d76d1650 | aurel32 | |
126 | d76d1650 | aurel32 | /* PowerPC Qemu tracks the various core input pins (interrupt, critical
|
127 | d76d1650 | aurel32 | * interrupt, reset, etc) in PPC-specific env->irq_input_state. */
|
128 | d76d1650 | aurel32 | if (run->ready_for_interrupt_injection &&
|
129 | d76d1650 | aurel32 | (env->interrupt_request & CPU_INTERRUPT_HARD) && |
130 | d76d1650 | aurel32 | (env->irq_input_state & (1<<PPC40x_INPUT_INT)))
|
131 | d76d1650 | aurel32 | { |
132 | d76d1650 | aurel32 | /* For now KVM disregards the 'irq' argument. However, in the
|
133 | d76d1650 | aurel32 | * future KVM could cache it in-kernel to avoid a heavyweight exit
|
134 | d76d1650 | aurel32 | * when reading the UIC.
|
135 | d76d1650 | aurel32 | */
|
136 | d76d1650 | aurel32 | irq = -1U;
|
137 | d76d1650 | aurel32 | |
138 | d76d1650 | aurel32 | dprintf("injected interrupt %d\n", irq);
|
139 | d76d1650 | aurel32 | r = kvm_vcpu_ioctl(env, KVM_INTERRUPT, &irq); |
140 | d76d1650 | aurel32 | if (r < 0) |
141 | d76d1650 | aurel32 | printf("cpu %d fail inject %x\n", env->cpu_index, irq);
|
142 | d76d1650 | aurel32 | } |
143 | d76d1650 | aurel32 | |
144 | d76d1650 | aurel32 | /* We don't know if there are more interrupts pending after this. However,
|
145 | d76d1650 | aurel32 | * the guest will return to userspace in the course of handling this one
|
146 | d76d1650 | aurel32 | * anyways, so we will get a chance to deliver the rest. */
|
147 | d76d1650 | aurel32 | return 0; |
148 | d76d1650 | aurel32 | } |
149 | d76d1650 | aurel32 | |
150 | d76d1650 | aurel32 | int kvm_arch_post_run(CPUState *env, struct kvm_run *run) |
151 | d76d1650 | aurel32 | { |
152 | d76d1650 | aurel32 | return 0; |
153 | d76d1650 | aurel32 | } |
154 | d76d1650 | aurel32 | |
155 | d76d1650 | aurel32 | static int kvmppc_handle_halt(CPUState *env) |
156 | d76d1650 | aurel32 | { |
157 | d76d1650 | aurel32 | if (!(env->interrupt_request & CPU_INTERRUPT_HARD) && (msr_ee)) {
|
158 | d76d1650 | aurel32 | env->halted = 1;
|
159 | d76d1650 | aurel32 | env->exception_index = EXCP_HLT; |
160 | d76d1650 | aurel32 | } |
161 | d76d1650 | aurel32 | |
162 | d76d1650 | aurel32 | return 1; |
163 | d76d1650 | aurel32 | } |
164 | d76d1650 | aurel32 | |
165 | d76d1650 | aurel32 | /* map dcr access to existing qemu dcr emulation */
|
166 | d76d1650 | aurel32 | static int kvmppc_handle_dcr_read(CPUState *env, uint32_t dcrn, uint32_t *data) |
167 | d76d1650 | aurel32 | { |
168 | d76d1650 | aurel32 | if (ppc_dcr_read(env->dcr_env, dcrn, data) < 0) |
169 | d76d1650 | aurel32 | fprintf(stderr, "Read to unhandled DCR (0x%x)\n", dcrn);
|
170 | d76d1650 | aurel32 | |
171 | d76d1650 | aurel32 | return 1; |
172 | d76d1650 | aurel32 | } |
173 | d76d1650 | aurel32 | |
174 | d76d1650 | aurel32 | static int kvmppc_handle_dcr_write(CPUState *env, uint32_t dcrn, uint32_t data) |
175 | d76d1650 | aurel32 | { |
176 | d76d1650 | aurel32 | if (ppc_dcr_write(env->dcr_env, dcrn, data) < 0) |
177 | d76d1650 | aurel32 | fprintf(stderr, "Write to unhandled DCR (0x%x)\n", dcrn);
|
178 | d76d1650 | aurel32 | |
179 | d76d1650 | aurel32 | return 1; |
180 | d76d1650 | aurel32 | } |
181 | d76d1650 | aurel32 | |
182 | d76d1650 | aurel32 | int kvm_arch_handle_exit(CPUState *env, struct kvm_run *run) |
183 | d76d1650 | aurel32 | { |
184 | d76d1650 | aurel32 | int ret = 0; |
185 | d76d1650 | aurel32 | |
186 | d76d1650 | aurel32 | switch (run->exit_reason) {
|
187 | d76d1650 | aurel32 | case KVM_EXIT_DCR:
|
188 | d76d1650 | aurel32 | if (run->dcr.is_write) {
|
189 | d76d1650 | aurel32 | dprintf("handle dcr write\n");
|
190 | d76d1650 | aurel32 | ret = kvmppc_handle_dcr_write(env, run->dcr.dcrn, run->dcr.data); |
191 | d76d1650 | aurel32 | } else {
|
192 | d76d1650 | aurel32 | dprintf("handle dcr read\n");
|
193 | d76d1650 | aurel32 | ret = kvmppc_handle_dcr_read(env, run->dcr.dcrn, &run->dcr.data); |
194 | d76d1650 | aurel32 | } |
195 | d76d1650 | aurel32 | break;
|
196 | d76d1650 | aurel32 | case KVM_EXIT_HLT:
|
197 | d76d1650 | aurel32 | dprintf("handle halt\n");
|
198 | d76d1650 | aurel32 | ret = kvmppc_handle_halt(env); |
199 | d76d1650 | aurel32 | break;
|
200 | d76d1650 | aurel32 | } |
201 | d76d1650 | aurel32 | |
202 | d76d1650 | aurel32 | return ret;
|
203 | d76d1650 | aurel32 | } |